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MPC8572EAMC Functional Description
Table 5-10. 88E1112 Reset Configuration Settings (continued)
Config
Config_4
Config_5
Configuration
00
11
Comments
No EEPROM Read
SGMII MAC interface to 1000Base-X, auto media select, such as AdvancedMC
BACKPLANE
Therefore, front panel eTSEC1 Gigabit Ethernet has physical address 0x00h and eTSEC2/3/4 have
addresses 0x01h, 0x03h, and 0x04h, respectively. eTSEC1 and eTSEC2 are configured as SGMII copper
interfaces, and eTSEC3 and eTSEC4 are both configured as an SGMII fiber interface.
The last Ethernet interface used on the MPC8572EAMC is generated using Marvell’s 88E3018 PHY.
Using hardware configuration pins, this 10/100BaseT PHY is configured in much the same way as the
88E1112 PHYs that have just been discussed. The 88E3018 is configured using four configuration bits and
a three bit control word as shown in Table 5-11 .
Table 5-11. 88E3018 PHY Configuration Pins
Pin
Config0
Config1
Config2
Config3
Bit[2]
RES
RES
RES
MODE[2]
Bit[1]
PHYADDR[1]
PHYADDR[3]
ENA_XC
MODE[1]
Bit[0]
PHYADDR[0]
PHYADDR[2]
PHYADDR[4]
MODE[0]
The 88E3018 PHY uses the VSS, LED[0:2], CRS, COL and VDDO pins to drive different hardware
configuration words onto pins during power up. Table 5-12 details the pins used to set the values of the
88E3018’s configuration pins.
Table 5-12. 8E3018 Pin Configuration Values
Pin
VSS
LED[0]
LED[1]
LED[2]
CRS
COL
VDDO
Bits[2:0]
000
001
010
011
100
110
111
MPC8572EAMC Advanced Mezzanine Card User Guide, Rev. 1.2
5-18
Freescale Semiconductor
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